Intel、データセンタ指向のXeon CPUやチップ内接\術を矢Mぎ早に発表

Intelがデータセンタにおける最新CPUと、アクセラレータとしてのFPGA「Agilex」、3D-Xpointメモリを使ったDIMM⊂のパーシステントメモリなどデータセンタ向けの発表を行ったが、さらにCPUとアクセラレータ間の接などに~効な新格CXLとそのコンソーシアムを矢Mぎ早に発表、Google Cloudとの共同開発も発表した。 [→きを読む]
Intelがデータセンタにおける最新CPUと、アクセラレータとしてのFPGA「Agilex」、3D-Xpointメモリを使ったDIMM⊂のパーシステントメモリなどデータセンタ向けの発表を行ったが、さらにCPUとアクセラレータ間の接などに~効な新格CXLとそのコンソーシアムを矢Mぎ早に発表、Google Cloudとの共同開発も発表した。 [→きを読む]
Intelは、AlteraをA収してから初めてのFPGAブランドになる「Agilex」を発表した。これまでハイエンドのStratix 10と比べて、性Δ40%向屬掘⊂嫡J電は40%削したという。初めての10nmプロセスで設されている。このFPGAは、エッジからクラウドまでカバーする高集積の半導アクセラレータを実現する。その実現のカギは? [→きを読む]
東j学CIES主のテクノロジーフォーラム(図1)が今Qも開され、STT-MRAM\術の位づけがより確になってきた。マイコンやロジックへの組み込みメモリ(RAM)としての位づけである。ReRAMやPCRAMのような書き換えv数にU限のあるデバイスは、不ァ発性メモリROMにZい使い気里泙襦 [→きを読む]
Xilinxがデータセンター向けのFPGAハードウエアアクセラレータALVEO(図1)にを入れている。このアクセラレーションカードは、サーバなどのコンピュータに接してそのまま使える。アクセラレータのコアにはFPGAを使っているためハードワイヤードロジックで高]、しかも再構成できるフレキシビリティをeつ。最新ALVEO U280は機械学{をT識してINT8(8ビットのD数演Q)で24.5TOPsの性Δ魴eつ。 [→きを読む]
SamsungがHBM2よりさらにメモリバンド幅の広いHBM2E格にじたを発表した。データレートが3.2Gbpsと極めて高]で、Flashboltと}ばれている。次世代のデータセンターに向けた。Nvidiaが3月19日から開したGTC(GPU Technology Conference)で発表されたもの。NvidiaはトヨタとのO動運転の提携を拡jすると発表した。 [→きを読む]
O動ZのW・W心を{求し故のないZを{求することでECU(電子U御ユニット)の数はこれまで\加しけてきた。ADASやO動運転ではなるIT・エレクトロニクス化がcけられない。しかし、ECU数が\えれば\えるほど配線は\え_量が\すことになる。低コスト化のT味でもECU\加の妓はしいのだろうか。Wind RiverはECUの数をらす仮[化\術にDり組んでいる。2019Q1月に日本法人代表D締役社長に任したMichael Krutzに聞いた。 [→きを読む]
Pure Storage社は、オンプレミスでWされてきた来のデータバックアップシステムに代わりクラウドWのバックアップを可Δ砲垢襯愁侫肇Ε┘ObjectEngineを2|開発(図1)した。バックアップとして、来のオンプレでのテープを使わず、あくまでもクラウド屬離侫薀奪轡絅▲譽い膨拘保Tするが、IoT/AI分析にも使うという新しい使い気鯆鶲討靴拭 [→きを読む]
営W団であるLinux Foundationがオープンソースの半導チップを推進するプロジェクトCHIPS Allianceを立ち屬欧拭このアライアンスは、シリコンチップの設に関する高のオープンソースコードをDり仕切り、チップ設をもっと効率よくフレキシブルに創出することを`的とする。RISC-Vとも協する。 [→きを読む]
Intelは、5G時代のコア基地局に向けたFPGAソリューションをアクセラレーションカードの形で提供する。これはMWC(Mobile World Congress)で発表したが、このほど東BでもこのIntel FPGA PAC N3000(図1)をお披露`した。このカードは、ミッドレンジのFPGA であるArria 10を使ったカードで、最j100Gbpsの中〜高]のネットワークに向く。 [→きを読む]
東Bj学は、噞\術総合研|所と共同で、AI(人工Α縫船奪廚魍発するため設拠点を本戰ャンパス内にある田先端凜咼襪肪曚、動を開始した。設ツールやハードウエア検証するためのb理エミュレータを揃え、中小のベンチャー企業をに提供する。 [→きを読む]
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